電路設(shè)計(jì)寶典：淺談555電路設(shè)計(jì).doc

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1、電路設(shè)計(jì)寶典：淺談555電路設(shè)計(jì)　　555定時(shí)器是一種模擬和數(shù)字功能相結(jié)合的中規(guī)模集成器件。一般用雙極型（TTL）工藝制作的稱為555，用互補(bǔ)金屬氧化物（CMOS）工藝制作的稱為7555，除單定時(shí)器外，還有對(duì)應(yīng)的雙定時(shí)器556/7556。555定時(shí)器的電源電壓范圍寬，可在4.5V~16V工作，7555可在3~18V工作，輸出驅(qū)動(dòng)電流約為200mA，因而其輸出可與TTL、CMOS或者模擬電路電平兼容。1972年，美國(guó)SigneTIcs公司研制555定時(shí)器用于取代機(jī)械式定時(shí)器的中規(guī)模集成電路，因輸入端設(shè)計(jì)有三個(gè)5kΩ的電阻而得名?！　　　∫弧⒒驹怼　?55

2、時(shí)基電路的工作過(guò)程如下：當(dāng)2腳，即比較器A2的反相輸入端加進(jìn)電位低于?VDD的觸發(fā)信號(hào)時(shí)，則VT9、VTll導(dǎo)通，給雙穩(wěn)態(tài)觸發(fā)器中的VTl4提供一偏流，使VTl4飽和導(dǎo)通，它的飽和壓降Vces箝制VTl5的基極處于低電平，使VTl5截止，VTl7飽和，從而使VTl8截止，VTl9導(dǎo)通，VT20完全飽和導(dǎo)通，VT21截止。因此，輸出端3腳輸出高電平。此時(shí)，不管6端（閾值電壓）為何種電平，由于雙穩(wěn)態(tài)觸發(fā)器（VTl4-VTl7）中的4．7kΩ電阻的正反饋?zhàn)饔茫╒Tl5的基極電流是通過(guò)該電阻提供的），3腳輸出高電平狀態(tài)一直保持到6腳出現(xiàn)高于?VDD的電平為止。當(dāng)觸

3、發(fā)信號(hào)消失后，即比較器A2反相輸入端2腳的電位高于?VDD，則VT9、VTll截止，VTl4因無(wú)偏流而截止，此時(shí)若6腳無(wú)觸發(fā)輸入，則VTl7的Vces飽和壓降通過(guò)4.7kΩ電阻維持VTl3截止，使VTl7飽和穩(wěn)態(tài)不變，故輸出端3腳仍維持高電平。同時(shí)，VTl8的截止使VT6也截止。當(dāng)觸發(fā)信號(hào)加到6腳時(shí)，且電位高于?VDD時(shí)，則VTl、VT2、VT3皆導(dǎo)通。此時(shí)，若2腳無(wú)外加觸發(fā)信號(hào)使VT9、VTl4截止，則VT3的集電極電流供給VTl5偏流，使該級(jí)飽和導(dǎo)通，導(dǎo)致VTl7截止，進(jìn)而VTl8導(dǎo)通，VTl9、VT2。都截止，VT21飽和導(dǎo)通，故3腳輸出低電平。當(dāng)6

4、腳的觸發(fā)信號(hào)消失后，即該腳電位降至低于?VDD時(shí)，則VTl、VT2、VT3皆截止，使VTl5得不到偏流。此時(shí)，若2腳仍無(wú)觸發(fā)信號(hào)，則VTl5通過(guò)4.7kΩ電阻得到偏流，使VTl5維持飽和導(dǎo)通，VTl7截止的穩(wěn)態(tài)，使3腳輸出端維持在低電平狀態(tài)。同時(shí)，VTl8的導(dǎo)通，使放電級(jí)VT6飽和導(dǎo)通。通過(guò)上面兩種狀態(tài)的分析，可以發(fā)現(xiàn)：只要2腳的電位低于?VDD，即有觸發(fā)信號(hào)加入時(shí)，必使輸出端3腳為高電平；而當(dāng)6腳的電位高于?VDD時(shí)，即有觸發(fā)信號(hào)加進(jìn)時(shí)，且同時(shí)2腳的電位高于?VDD時(shí)，才能使輸出端3腳有低電平輸出。4腳為復(fù)位端。當(dāng)在該腳加有觸發(fā)信號(hào)，即其電位低于導(dǎo)通的飽

5、和壓降0.3V時(shí)，VT8導(dǎo)通，其發(fā)射極電位低于lV，因有D3接入，VTl7為截止?fàn)顟B(tài)，VTl8、VT21飽和導(dǎo)通，輸出端3腳為低電平。此時(shí)，不管2腳、6腳為何電位，均不能改變這種狀態(tài)。因VT8的發(fā)射極通過(guò)D3及VTl7的發(fā)射極到地，故VT8的發(fā)射極電位任何情況下不會(huì)比1.4V電壓高。因此，當(dāng)復(fù)位端4腳電位高于1.4V時(shí)，VT8處于反偏狀態(tài)而不起作用，也就是說(shuō)，此時(shí)輸出端3腳的電平只取決于2腳、6腳的電位。