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《引出時(shí)序邏輯電路》由會員上傳分享,免費(fèi)在線閱讀,更多相關(guān)內(nèi)容在教育資源-天天文庫。
1、第四章觸發(fā)器開始引出時(shí)序邏輯電路按工作方式分類異步觸發(fā)器按功能分類RS觸發(fā)器課堂教學(xué)設(shè)計(jì)結(jié)構(gòu)框架任務(wù)驅(qū)動+案例+演示引入電子時(shí)鐘電路課件與組合邏輯電路的區(qū)別時(shí)序邏輯電路概念同步JK觸發(fā)器D觸發(fā)器T觸發(fā)器T’觸發(fā)器各種觸發(fā)器間的轉(zhuǎn)換功能分析波形仿真演示小結(jié)結(jié)束觸發(fā)器應(yīng)用師生和諧互動同學(xué)們想不想知道我內(nèi)部的電路結(jié)構(gòu)?繼續(xù)學(xué)習(xí)后面的幾個(gè)章節(jié),你就能全面了解我了!數(shù)字電子鐘原理電路時(shí)序邏輯電路的輸出狀態(tài)不僅決定于當(dāng)時(shí)的輸入狀態(tài),而且與電路原來的狀態(tài)有關(guān);在電路結(jié)構(gòu)上存在反饋,具有記憶功能。即在輸入信號撤銷后能保持在輸入信號作用
2、時(shí)所具有的輸出狀態(tài)組合邏輯電路的輸出狀態(tài)完全由當(dāng)時(shí)的輸入變量的組合狀態(tài)決定,與電路的原狀態(tài)無關(guān)。觸發(fā)器概述:觸發(fā)器是構(gòu)成時(shí)序邏輯電路的基本單元電路。觸發(fā)器具有記憶功能,能存儲一位二進(jìn)制數(shù)碼。觸發(fā)器有三個(gè)基本特性:(1)有兩個(gè)穩(wěn)態(tài),可分別表示二進(jìn)制數(shù)碼0和1,無外觸發(fā)時(shí)可維持穩(wěn)態(tài);(2)外觸發(fā)下,兩個(gè)穩(wěn)態(tài)可相互轉(zhuǎn)換(稱翻轉(zhuǎn));(3)有兩個(gè)互補(bǔ)輸出端。本章將按觸發(fā)器的電路結(jié)構(gòu)、觸發(fā)方式、邏輯功能分別進(jìn)行介紹。按邏輯功能可分為:雙穩(wěn)態(tài)觸發(fā)器、單穩(wěn)態(tài)觸發(fā)器、無穩(wěn)態(tài)觸發(fā)器(多諧振蕩器)。雙穩(wěn)態(tài)觸發(fā)器中又包含RS觸發(fā)器、JK觸發(fā)器
3、、D觸發(fā)器和T觸發(fā)器等。觸發(fā)器按有無動作的統(tǒng)一時(shí)間節(jié)拍分為:基本觸發(fā)器、時(shí)鐘觸發(fā)器。按電路結(jié)構(gòu)可分為:主從觸發(fā)器、單維持阻塞觸發(fā)器和時(shí)鐘觸發(fā)器。觸發(fā)器分類:1.基本RS觸發(fā)器由兩個(gè)與非門交叉連接而成&G1&G2QQ規(guī)定:以Q端的狀態(tài)為觸發(fā)器的狀態(tài),Q=1時(shí)稱為觸發(fā)器為1狀態(tài),Q=0時(shí)稱為觸發(fā)器為0狀態(tài)。邏輯符號圖低電平有效QQ第一節(jié)基本RS觸發(fā)器10111001輸出保持原狀態(tài):&G1&G2若原狀態(tài):輸入RD=1,SD=1時(shí)輸入RD=1,SD=1時(shí)若原狀態(tài):01110110輸出保持原狀態(tài):&G1&G2結(jié)論時(shí),觸發(fā)器原狀態(tài)
4、若為“0”,則新狀態(tài)為“0”。若原狀態(tài)為“1”,則新狀態(tài)仍為“1”。觸發(fā)器未接受低電平信號時(shí),無論原狀態(tài)如何,輸出都保持原狀態(tài)不變。具有兩個(gè)穩(wěn)定狀態(tài),又稱為雙穩(wěn)態(tài)觸發(fā)器。輸入SD=0,RD=1時(shí)若原狀態(tài):10101011輸出變?yōu)椋?G1&G2輸入SD=0,RD=1時(shí)若原狀態(tài):00110101輸出保持:&G1&G2時(shí),觸發(fā)器原狀態(tài)若為“0”,則新狀態(tài)為“1”。若原狀態(tài)為“1”,則新狀態(tài)仍為“1”。即無論原狀態(tài)如何,基本RS觸發(fā)器都輸出“1”,所謂“置位”狀態(tài)。時(shí)考慮到電路的對稱性,觸發(fā)器的輸出狀態(tài)應(yīng)為“0”,即所謂“復(fù)位
5、”狀態(tài)。直接復(fù)位端(RESET)直接置位端(SET)低電平有效輸入RD=0,SD=0時(shí)0011輸出全是1與邏輯功能相矛盾且當(dāng)同時(shí)變?yōu)?時(shí),速度快的門輸出先變?yōu)?,另一個(gè)不變。輸出狀態(tài)由偶然因素決定。&G1&G2結(jié)論輸入RD=0,SD=0時(shí),基本RS觸發(fā)器的輸出不定,屬于禁止出現(xiàn)的狀態(tài)?;綬S觸發(fā)器的置位、復(fù)位和保持不變的邏輯功能,可實(shí)現(xiàn)數(shù)碼的存儲和記憶。由于有禁態(tài),所以使用受到一定限制。狀態(tài)轉(zhuǎn)換表(特性表)現(xiàn)態(tài):指觸發(fā)器輸入信號變化前的狀態(tài),用Qn表示;次態(tài):指觸發(fā)器輸入信號變化后的狀態(tài),用Qn+1表示。特性表:次態(tài)
6、Qn+1與輸入信號和現(xiàn)態(tài)Qn之間關(guān)系的真值表。與非門組成的基本RS觸發(fā)器的狀態(tài)轉(zhuǎn)換表邏輯功能的表示方法:0110110010不變不定Q狀態(tài)表的簡化:次態(tài)Qn+1的卡諾圖特性方程觸發(fā)器的特性方程就是觸發(fā)器次態(tài)Qn+1與輸入及現(xiàn)態(tài)Qn之間的邏輯關(guān)系式波形圖反映觸發(fā)器輸入信號取值和狀態(tài)之間對應(yīng)關(guān)系的圖形稱為波形圖RSQQ置1置0置1置1置1保持不允許一般先設(shè)輸入初始狀態(tài),然后根據(jù)給定輸入信號波形,相應(yīng)畫出輸出端的波形。4.1.2或非門組成的基本RS觸發(fā)器或非門組成的基本RS觸發(fā)器(a)邏輯電路(b)邏輯符號輸入信號R、S為高
7、電平有效觸發(fā)。高電平有效或非門組成的基本RS觸發(fā)器的狀態(tài)轉(zhuǎn)換表R高電平有效置0S高電平有效置1基本RS觸發(fā)器的特點(diǎn)(1)觸發(fā)器的次態(tài)不僅與輸入信號狀態(tài)有關(guān),而且與觸發(fā)器的現(xiàn)態(tài)有關(guān)。(2)電路具有兩個(gè)穩(wěn)定狀態(tài),在無外來觸發(fā)信號作用時(shí),電路將保持原狀態(tài)不變。(3)在外加觸發(fā)信號有效時(shí),電路可以觸發(fā)翻轉(zhuǎn),實(shí)現(xiàn)置0或置1。(4)在穩(wěn)定狀態(tài)下兩個(gè)輸出端的狀態(tài)和必須是互補(bǔ)關(guān)系,即有約束條件。在數(shù)字電路中,凡根據(jù)輸入信號R、S情況的不同,具有置0、置1和保持功能的電路,都稱為RS觸發(fā)器?;綬S觸發(fā)器的觸發(fā)方式:邏輯電平直接觸發(fā)。(
8、由輸入信號直接控制)。但是在實(shí)際工作中,要求觸發(fā)器按統(tǒng)一的節(jié)拍進(jìn)行狀態(tài)更新。措施:同步觸發(fā)器(時(shí)鐘觸發(fā)器或鐘控觸發(fā)器):具有時(shí)鐘脈沖CP控制的觸發(fā)器。該觸發(fā)器狀態(tài)的改變與時(shí)鐘脈沖同步。CP:控制時(shí)序電路工作節(jié)奏的固定頻率的脈沖信號,一般是矩形波。同步觸發(fā)器的狀態(tài)更新時(shí)刻:受CP輸入控制。觸發(fā)器更新為何種狀態(tài):由觸發(fā)輸入信號決定。第