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1、MAX+PLUSII學習課件(中文版)Max+PlusII用戶 使用入門指南EDA工作室E-mail:Zhongyou@public.wh.hb.cn7/25/20211湖北眾友科技EDA工作室MAX+PLUSII學習課件目錄第一章Max+PlusII的功能及系統(tǒng)要求第二章Max+PlusII的安裝向導第三章Max+PlusII的設計流程第四章圖形輸入方法的設計過程第五章工具條和常用菜單選項說明第六章圖形的層次化設計及BUS使用第七章硬件語言描述輸入法第八章混合設計輸入法第九章基于LPM的設計功能第十章應用中常見錯誤及處理方法第一章Ma
2、x+PlusII的功能及系統(tǒng)要求Altera公司的MAX+PLUSII軟件是最易學、最易用的可編程邏輯器件開發(fā)軟件。其界面友好，集成化程度高，包含設計綜合仿真等。返回目錄7/25/20213湖北眾友科技EDA工作室1.1MAX+plusII10.2的功能獨立的運行環(huán)境設計輸入設計編譯驗證和編程EDIFLPM及其他EDIFVerilogVHDLSDF標準EDA設計輸入:標準的EDA設計驗證方式:CadenceMentorGraphicsLogicModellingSynopsysViewlogic其他方式CadenceMentorGrap
3、hicsOrCADSynopsysViewlogic其他輸入方式MAX+PLUSII編譯器圖形設計輸入文本設計輸入(AHDL,VHDL,VerilogHDL)波形設計輸入DesignEntry分層設計輸入版圖編輯設計規(guī)則檢查邏輯綜合裝入器件多器件劃分自動錯誤定位定時驅動編譯定時仿真功能仿真多器件仿真定時分析器件編程7/25/20214湖北眾友科技EDA工作室1.1MAX+plusII10.2的功能支持的器件所支持的器件有：ACEX1K,EPF10K10,EPF10K10A,EPF10K20，EPF10K30A以及MAX?7000系列（含
4、MAX7000A,MAX7000AE,MAX7000E,MAX7000S），EPM9320,EPM9320A,EPF8452A,EPF8282A，F(xiàn)LEX6000/A系列，MAX5000系列，ClassicTM系列。設計輸入常用的設計輸入方法有：通過圖形編輯器，創(chuàng)建圖形設計文件（.gdf）;通過文本編輯器，使用AHDL語言，創(chuàng)建文本編輯文件（.tdf）；使用VHDL語言，創(chuàng)建文本設計文件（?.vhd）；使用VerilogHDL語言，創(chuàng)建文本設計文件（.v）。通過波形編輯器，創(chuàng)建波形設計文件（.wdf）等。7/25/20215湖北眾友科技
5、EDA工作室1.1MAX+plusII10.2的功能MAX+PLUSII的圖形編輯器MAX+PLUSII的文本編輯器MAX+PLUSII的符號編輯器MAX+PLUSII的版圖編輯器頂層文件.gdf頂層設計文件可以是下列格式：.gdf,.tdf,.vhd,.sch,和.edf.wdf.vhd.v.sch.edf.xnf圖形文件波形文件文本文件圖形文件文本文件文本文件從其他EDA工具輸入OrCADSynopsys,ViewLogic,MentorGraphics,等廠商的EDIF文件XilinxMAX+PLUSII自身產(chǎn)生VHDL/Veri
6、log波形輸入圖形輸入.tdf文本文件AHDL設計輸入文件描述圖7/25/20216湖北眾友科技EDA工作室1.1MAX+plusII10.2的功能設計輸入總結圖設計文件支持文件MAX+PLUSII圖形編輯器MAX+PLUSII文本編輯器MAX+PLUSII符號編輯器MAX+PLUSII波形編輯器.gdf.tdf.vhd.sch.edf.xnfMAX+PLUSII第三方EDA工具.sym.inc用戶.wdf.lmf7/25/20217湖北眾友科技EDA工作室1.1MAX+plusII10.2的功能設計編譯通過MAX+plusⅡ編譯器，可
7、檢查項目是否有錯，并對項目進行邏輯綜合，然后配置到一個ALTERA器件中，同時產(chǎn)生報告文件、編輯文件和用于時間仿真的輸出文件。設計校驗通過MAX+plusⅡ的定時分析器進行時序分析、功能仿真、時序仿真和波形分析，生成一些標準文件為其他EDA工具使用。器件編程（Programming）和配置（Cofiguration）在線幫助7/25/20218湖北眾友科技EDA工作室1.1MAX+plusII10.2的功能編譯器的輸入輸出文件描述圖MAX+PLUSII設計文件(.gdf,.tdf,.vhd)MAX+PLUSII編譯器編譯器網(wǎng)表提取模塊（
8、包含各種網(wǎng)表的閱讀器）功能、定時或鏈接SNF提取模塊EDIF、VHDL和VerilogNetlist生成模塊數(shù)據(jù)庫生成模塊劃分模塊設計醫(yī)生邏輯綜合模塊裝入模塊裝配模塊第三方EDA設計文件(.edf,.sch
