羅克韋爾實驗指導

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1、實驗一RSLogix500的使用一、實驗?zāi)康?.熟悉實驗平臺的硬件結(jié)構(gòu)2.進一步熟悉編程軟件的使用和程序的調(diào)試方法。3.正確理解PLC循環(huán)扌「I描的工作過程。4.掌握PLC的硬件接線方法。二、實驗設(shè)備1.含可編程序控制器MicroLogixl400系列PLC的DEMO實驗箱一個2.可編程序控制器的編程器一個（裝有編程軟件的PC電腦）。3.導線若干4.以太網(wǎng)通訊線一根三、實驗原理RSLogix500軟件是一款丿IJ于A-B小型PLC的編程軟件，如SLC500,MicroLogixlOOO,Micr

2、oLogixl200,MicroLogixl400,MicroLogixl500等PLC?，F(xiàn)以實現(xiàn)交通指揮信號燈的控制為例，介紹RSLogix500的編程方法。四、實驗步驟運行RSLogix500軟件，點擊File/New,彈出SelectProcessorType對話框，選擇該實驗應(yīng)用的MicroLogix1400SeriesAo點擊OK,進入RSLogix500的編程界面,如圖1?3所示。左邊為新建的應(yīng)用程序的工程樹，右邊為梯形圖編程主窗口。圖1-1RSLogix500的編程界面1、點擊工程

3、樹屮的目錄前的加號可以把該項內(nèi)容展開。工程樹主要包括以下內(nèi)容：1）處理器Controller在ControllerR錄下有ControllerPropertiesProcessorStatus>I/OConfiguration>ChannelConfiguration選項。在ControllerProperties選項卜可以選擇處理器的型號，以及対當前網(wǎng)絡(luò)連接上的哪臺控制器進行編程；在ProcessorStatus選項下可以查看處理器的狀態(tài)；在I/OConfiguration中進行I/O纟fl態(tài)

4、；在ChannelConfiguration屮進行通道纟fl態(tài)，可纟H.態(tài)為DF1協(xié)議或ETHIP協(xié)議。2）程序文件ProgramFiles在ProgramFilesId錄下存放著梯形圖程序。在MicroLogix14004*可以再新建梯形圖程序文件。LAD2為梯形圖主程序MAIN_PROG；LAD3為用戶故障處理子程序USER_FAULT,當發(fā)生可恢復性故障時執(zhí)行本文件；LAD4為高速計數(shù)中斷處理子程序HSCJNT,當發(fā)生高速計數(shù)中斷后自動執(zhí)行此了程序；LAD5為可選定時中斷處理了程序STIJ

5、NT,當發(fā)生可選定吋屮斷后口動執(zhí)行此子程序；LAD6-LAD15為用戶口定義子程序。3）數(shù)據(jù)文件DataFilesMicroLogix1400的數(shù)據(jù)文件有輸出文件00、輸入文件II、狀態(tài)文件S2、位文件B3、計時器文件T4、計數(shù)器文件C5、控制文件R6和整數(shù)文件N7。4）強置文件ForceFiles正常狀態(tài)下，處理器在運行時只有相應(yīng)的輸入點導通才能夠使輸入文件的相應(yīng)位置1;只有梯級邏輯使能輸出線圈，才能使相應(yīng)的輸岀點置1。在ForceFiles中可以対處理器的I/O進行強置0或置lo5）自定義數(shù)

6、據(jù)監(jiān)測CustomDataMonitors在CustomDataMonitors中可以監(jiān)測數(shù)據(jù)文件中的數(shù)據(jù)。6）趨勢圖Trends這是一個基于軟件的示波器，可以觀看數(shù)據(jù)文件中數(shù)據(jù)的變化曲線。7）I/O組態(tài)I/O組態(tài)是RSLogix500編程的重要內(nèi)容。MicroLogix1400fl

7、具指令可通過工具欄中如user、bit、time/counter>input/output>compare、math>move/logical>file/misc^fileshift/sequencer^programcontrol等中的符號進行選擇。在梯形圖中的所冇指令都可以通過拖拽的方式或點擊來加載到梯形圖屮。如果熟練也可以雙擊梯級，直接鍵入指令。所編寫的交通燈梯形圖程序，如圖I-6o注意：地址格式的書寫。比如，00:0/0表示輸出文件的第0個字的第0位，也就是MicroLogix1400處

8、理器上的0/0輸出點。11:0/0表示輸入文件的笫0個字的第0位,也就是MicroLogix1400處理器上的1/0輸入點。3、程序的合法性檢查程序編完后，選擇Edit/VerifyFile可對程序進行合法性檢查，可以檢查是否有語法錯誤。如果冇錯誤將在編程窗口的下部顯示，更正后再檢查，直到出現(xiàn)Verifyhascompleted,noerrorsfound信息。注意：合法性檢査只是對語法進行檢查，無法檢查出邏輯上的錯誤。因此在編寫梯形圖程序吋還是要認真的分析吋序邏輯，不耍期望讓RSLogix50