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1、現(xiàn)代集成電路應用綜合設計1課程簡介本課程是在《數(shù)字電子技術》、《EDA技術與VHDL》等課程的基礎上，以FPGA實驗系統(tǒng)為開發(fā)平臺,進行數(shù)字系統(tǒng)設計的實踐性課程.2本次課程設計的特點與特色從設計所采用核心芯片的特點來看,FPGA的應用之廣泛全面,發(fā)展勢頭之迅猛,掌握其設計此其時也在培養(yǎng)自主創(chuàng)新能力這個方面,數(shù)?；旌险n程設計及單片機課程設計都無法望其項背從課程內容的安排來看,本設計有承上啟下之功,可幫助同學們?yōu)閷戆l(fā)展選定方向本次設計采用循序漸進的方式進行,先做小實驗,再完成數(shù)字系統(tǒng)設計3FPGA實驗開發(fā)系統(tǒng)(DSP+FP
2、GA二合一)4取下TMS320VC54xDSP開發(fā)板即可進行獨立的FPGA實驗5FPGA實驗開發(fā)系統(tǒng)資源介紹6可完成數(shù)字系統(tǒng)開發(fā)設計的題目雙機應答器VGA顯示器控制器液晶顯示控制器秒表函數(shù)信號發(fā)生器電壓表自動售飲料控制器數(shù)字密碼鎖出租車自動計費器簡易交通燈控制器數(shù)字式頻率計多功能數(shù)字鐘7本課程設計的任務和要求一、設計任務按照本課件所提供的幾個實驗例程，熟練掌握QuartusII軟件的原理圖輸入、VHDL文本輸入及混合輸入等設計方法，完成實驗例程后面的思考題。在此基礎上利用FPGA實驗開發(fā)系統(tǒng)所提供的資源完成多功能數(shù)字鐘的
3、EDA設計。8二、具體要求1、數(shù)字鐘功能：數(shù)字鐘的時間為24小時一個周期；數(shù)字鐘須顯示時、分、秒。2、清零校時功能：可以實現(xiàn)時、分、秒清零功能；可以單獨調時、調分，使其調整到標準時間。3、整點報時功能：分位計數(shù)到59分鐘時，設置一個報警指示燈閃爍，并持續(xù)1分鐘。9多功能數(shù)字鐘的系統(tǒng)框圖10關于電腦和實驗箱的使用1、每人一臺電腦，每個同學須在電腦上獨立完成課件所規(guī)定的實驗和數(shù)字鐘的設計輸入、軟件編譯及仿真等過程。2、每兩人一臺實驗箱，要進行器件的編程下載和硬件測試時，可通過轉換并行接口線的方式以完成實驗。11考核方式平時成
4、績：20%課程考核：80%注：1、平時成績主要以同學們的遲到、早退、缺席情況進行考核。無故缺席一次及遲到或早退三次考核成績以零分計。2、課程考核主要以提問、操作考查、設計報告評分的方式進行。12課程設計報告要求設計報告必須人手一份，報告可以是電子打印稿。報告內容應盡量體現(xiàn)創(chuàng)新設計,照抄課件參考設計內容者會影響本門課程的最后成績,望好自為之13
