QuartusII中文完整教程.doc

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1、QuartusII的使用21工程建立22原理圖的輸入53文本編輯（verilog）154波形仿真1618QuartusII的使用在這里，首先用最簡單的實例向讀者展示使用QuartusII軟件的全過程。進入WINDOWSXP后，雙擊QuartusII圖標，屏幕如圖1.1所示。圖1.1QuartusII管理器1.1工程建立使用NewProjectWizard，可以為工程指定工作目錄、分配工程名稱以及指定最高層設(shè)計實體的名稱。還可以指定要在工程中使用的設(shè)計文件、其它源文件、用戶庫和EDA工具，以及目標器件系列和器件（也可以讓QuartusII軟件自動選擇器件）。

2、建立工程的步驟如下：（1）選擇File菜單下NewProjectWizard，如圖1.2所示。18圖1.2建立項目的屏幕（1）輸入工作目錄和項目名稱，如圖1.3所示?？梢灾苯舆x擇Finish，以下的設(shè)置過程可以在設(shè)計過程中完成。圖1.3項目目錄和名稱18（1）加入已有的設(shè)計文件到項目，可以直接選擇Next，設(shè)計文件可以在設(shè)計過程中加入，如圖1.4所示。圖1.4加入設(shè)計文件（2）選擇設(shè)計器件：選擇仿真器和綜合器類型（默認“None”為選擇QuartusII自帶的），選擇目標芯片（開發(fā)板上的芯片類型），如圖1.5所示。圖1.5選擇器件18（1）選擇第三方EDA

3、綜合、仿真和時序分析工具（若都不選擇，則使用QuartusII自帶的所有設(shè)計工具）如圖1.6所示。圖1.6選擇EDA工具（2）建立項目完成，顯示項目概要，如圖1.7所示。圖1.7項目概要工程建立后，若需要新增設(shè)計文件，可以通過Project/Add_Remove……在工程中添加新建立的設(shè)計文件，也可以刪除不需要的設(shè)計文件。編譯時將按此選項卡中顯示文件處理。注意：通過工程向?qū)ё鲎鞯脑O(shè)置都是可以在Assignments/settings下再進行修改的。181.2原理圖的輸入原理圖輸入的操作步驟如下：（1）選擇File菜單下New，新建圖表/原理圖文件，如圖1.

4、8所示。圖1.8新建原理圖文件（2）在圖1.9的空白處雙擊，屏幕如圖1.10所示：（3）在圖1.10的SymbolName輸入編輯框中鍵入名稱，單擊ok按鈕。此時可看到光標上粘著被選的符號，將其移到合適的位置（參考圖1.11）單擊鼠標左鍵，使其固定；（4）重復(fù)（2）、（3）步驟，給圖中放一個input、not、output符號，如圖1.11所示；在圖1.11中，將光標移到右側(cè)input右側(cè)待連線處單擊鼠標左鍵后，再移動到D觸發(fā)器的左側(cè)單擊鼠標左鍵，即可看到在input和D觸發(fā)器之間有一條線生成；18圖1.9空白的圖形編輯器圖1.10選擇元件符號的屏幕圖1.

5、11放置所有元件符號的屏幕（1）重復(fù)（4）的方法，完成所有的連線電路如圖1.12所示；（2）在圖1.12中，雙擊input_name使其襯低變黑后，再鍵入18clk，及命名該輸入信號為clk，用相同的方法將輸出信號定義成Q；如圖1.13所示。（1）在圖1.13中單擊保存按鈕，以默認的try1文件名保存，文件后綴為bdf。圖1.12完成連線后的屏幕圖1.13完成全部連接線的屏幕（2）啟動全程編譯：選擇Processing/StartCompilation/單擊編譯器快捷方式按鈕,自動完成分析、排錯、綜合、適配、匯編及時序分析的全過程。編譯過程中，錯誤信息通過

6、下方的信息欄指示（紅色字體）。雙18擊此信息，可以定位到錯誤所在處，改正后在此進行編譯直至排除所有錯誤；編譯成功后，會彈出編譯報告，顯示相關(guān)編譯信息。在圖1.8中；圖1.14完成編譯的屏幕（1）根據(jù)硬件接口設(shè)計，對芯片管腳進行綁定。選擇Assignments菜單下Pins選項；（2）雙擊對應(yīng)管腳后Location空白框，出現(xiàn)下拉菜單中選擇要綁定的管腳，如圖1.16所示；圖1.16管腳指定（3）在圖1.16中完成所有管腳的分配，然后重新編譯項目；18（1）對目標版適配下載，（此處認為實驗板已安裝妥當，有關(guān)安裝方法見實驗板詳細說明）單擊按鈕，屏幕顯示如圖1.1

7、7所示；圖1.18適配下載界面（2）選擇HardwareSetup，如圖1.19所示；圖1.19下載硬件設(shè)置（3）在圖1.19中選擇添加硬件ByteBlasteMVorByteBlasterII，如圖1.20所示；18圖1.20添加下載硬件（1）可以根據(jù)需要添加多種硬件于硬件列表中，雙擊可選列表中需要的一種，使其出現(xiàn)在當前選擇硬件欄中（本實驗板采用ByteBlasterII下載硬件），如圖1.21所示；圖1.21選擇當前下載硬件（2）選擇下載模式，本實驗板可采用兩種配置方式，AS模式對配置芯片下載，可以掉電保持，而JTGA模式對FPGA下載，掉電后FPGA

8、信息丟失，每次上電都需要重新配置，如圖1.22所示；18圖1.22